CMOS延迟电路以及抑制CMOS延迟电路温漂的方法
本发明的各实施方式提供了一种CMOS延迟电路以及抑制CMOS延迟电路温漂的方法。通过在任意两个相邻且串联的CMOS反相器之间加入延迟单元,可以有效地将CMOS延迟电路的温漂控制在理想范围之内,从而满足实际电路设计中可能存在的对温漂的高精度要求。
发明专利
CN201210528395.3
2012-12-06
CN103856191A
2014-06-11
H03K5/13(2014.01)I
艾尔瓦特集成电路科技(天津)有限公司
邹玉峰
300457 天津市塘沽区天津市经济技术开发区信环西路19号2号楼2701-2室
北京市金杜律师事务所 11256
酆迅
天津;12
一种CMOS延迟电路,包括:延迟单元,配置在至少两个串联的CMOS反相器之间,所述延迟单元的温度延迟特性与所述CMOS反相器的温度延迟特性相反。