基于FPGA的高速固态存储器优化设计
针对雷达信号采集系统中高采样率和ADC(模数转换器)带宽产生的海量数据的高速存储问题,对基于FPGA控制的LVDS(低压差分信号)高速数据通信接口的NANDFLASH为存储介质的高速固态存储器进行了优化设计.高速固态存储器采用了均衡加重、交替双平面交叉编程的分时加载技术操作、基于FPGA的二级缓存和三线组合指令等优化措施,平均存储速度不小于59 MB/s.高速固态存储器已成功应用于某导弹发射数据回收试验,优化设计的可行性和可靠性已通过工程实践验证.
现场可编程门阵列、低压差分信号、高速存储、NANDFLASH
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TP301.6(计算技术、计算机技术)
2016-09-18(万方平台首次上网日期,不代表论文的发表时间)
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