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10.3969/j.issn.1004-373X.2007.01.033

有限状态机的可靠性设计研究

引用
有限状态机是VLSI数字系统设计中关键的一环,是实现高效率的逻辑控制的一条重要途径,但是不完善的状态机设计可能会严重影响系统的可靠性和稳定性.本文研究了状态机的设计方法和编码方式,其中重点研究了通过深入分析状态机图和系统的控制要求,改进状态机的跳转条件和跳转方向来提高系统的可靠性,软件仿真结果验证了设计的有效性.

有限状态机、VHDL、可靠性与优化、状态编码

30

TP391.72(计算技术、计算机技术)

2007-03-05(万方平台首次上网日期,不代表论文的发表时间)

共2页

93-94

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1004-373X

61-1224/TN

30

2007,30(1)

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