10.3969/j.issn.1004-373X.2006.06.034
基于CPLD的8位总线接口设计
基于CPLD技术设计了双通道总线接口并给出该接口的通道模型和控制方法.本接口采用存储器访问模式,克服了某些CPU外围通信接口少的缺点,易于实现双CPU间的总线对接,且无需考虑复杂的总线仲裁机制.该接口适用于双主机间的数据传输,具有使用方便、速率匹配、实时响应等优点.同时采用VHDL硬件描述语言,使设计易于模块化,也为基于CPLD的总线转换及其他接口电路的设计提供了新的思路.
CPLD、VHDL、总线接口、总线仲裁
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TN92
2006-04-20(万方平台首次上网日期,不代表论文的发表时间)
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