10.3969/j.issn.1004-373X.2002.06.032
利用Cadence Allegro进行PCB级的信号完整性仿真
在高速PCB设计过程中,仅仅依靠个人经验布线,往往存在巨大的局限性.利用Cadence的Allegro软件包对电路进行PCB级的仿真,可以最优化线路布局,极大地提高电路设计质量,从而缩短设计周期.本文结合作者的实际设计经验,介绍使用Cadence的一般步骤并列举在使用过程中所发现的一些问题.
高速PCB布线、Allegro、文件转换、信号完整性仿真
TP3(计算技术、计算机技术)
2004-02-06(万方平台首次上网日期,不代表论文的发表时间)
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