10.3969/j.issn.1002-2279.2016.05.004
IP核打包及验证方法研究
IP 核是集成电路设计的升华,是超大规模 SoC 电路设计不可或缺的物质基础。IP 核打包是 IP 核发布给用户之前一个非常重要的环节。目前,IP 核的格式比较灵活,有 coreKit、IP -XACT 等。考虑到 IP 核的完整性,以 coreKit 格式为例,借助于 coreTools EDA 工具对 IP 核打包及验证方法进行了较为详细的研究。先从 IP 核的数据准备开始,指出需要提供 HDL 配置和接口定义两个相关的辅助文件;再从打包过程的七个步骤:建立打包流程、启动 coreBuilder 工具、输入设置、存储器映射、验证、综合设置和打包等,对其进行一步一步阐述;最后通过 IP 核发布和 IP 核集成对 IP 核打包的结果加以验证,证明 IP 核包的正确性和实用性。
IP核、打包、发布、综合策略、约束、集成、验证
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TN4(微电子学、集成电路(IC))
2016-11-23(万方平台首次上网日期,不代表论文的发表时间)
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