10.3969/j.issn.1671-4598.2013.04.060
一种高效双精度浮点乘法器
浮点乘法器(FPM)是中央处理器的关键部件之一,因此其性能是处理器的关键影响因素之一,高性能浮点乘法器是研究人员的追求;基于此需求,提出了一种高速双精度浮点乘法器,该设计采用了有别于传统基2Booth算法,即基4Booth算法产生部分积,在此基础上用优化的Wallace树阵列结构进行部分积的累加得到和序列和进位序列,进而对和序列和进位序列采用部分和并行相加得到最后尾数结果;采用了优化的10级流水线结构的设计在Cyclone Ⅱ EP2C15AF484C6器件上实现后运行频率可达138.77 MHz;在同等优化努力下,相比于Ahera IP核运行速度提高大约67.77%;类似的,在Xilinx Virtex2 xc2v6000上的实现比现存的设计频率提高约102.2%;实验结果显示了所设计FPM结构的有效性.
基4Booth编码、双精度浮点数、浮点乘法器、并行结构、流水线结构、Wallace树
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TP332(计算技术、计算机技术)
国家自然科学基金61072135,60788402;武汉市科技攻关计划项目201110921295
2015-01-20(万方平台首次上网日期,不代表论文的发表时间)
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