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10.3778/j.issn.1002-8331.2010.01.018

NCL电路并行处理结构研究

引用
针对NCL电路数据编码方式的特点,提出了一种并行数据处理的NCL电路结构,通过同时对两路双轨编码数据流的并行处理,提前计算出下一个无效数据,缩短了无效数据维持时间.此结构应用到4x4乘法器的设计,采用COMS 0.18岬工艺,乘法器在非流水模式下和2级流水模式下分别进行了综合、布局布线和仿真,与传统NCL 4x4乘法器相比,无效数据维持时间分别缩短了32.9%和33.2%.

零约束逻辑电路、并行处理、异步电路

46

TP332(计算技术、计算机技术)

2010-03-29(万方平台首次上网日期,不代表论文的发表时间)

共4页

54-56,60

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计算机工程与应用

1002-8331

11-2127/TP

46

2010,46(1)

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