10.16157/j.cnki.0258-7998.2014081502980
基于FPGA的高速时间交替采样系统
提出了一种高速高精度数据采集系统的设计.ADC高速采样基于时间交替采样结构实现,以FPGA为逻辑控制芯片,DSP为误差矫正算法处理中心.在对系统总体设计各模块进行介绍的基础上,重点分析了系统存在的偏移误差、时延误差和增益误差,并描述了一种误差矫正方法.通过实验测试,结果表明该设计能够实现1 GS/s的高速采样,并能完成明显的误差矫正.
时间交替采样、FPGA、误差矫正、高速采样
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TN957.5
2015-02-13(万方平台首次上网日期,不代表论文的发表时间)
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