10.3969/j.issn.0258-7998.2006.10.033
突发通信中Turbo码的FPGA实现
给出了低复杂度和低延迟的Turbo码编译码的FPGA实现方案,方案中分量码译码算法采用Max-Log-Map算法.基于提出的设计方案,在Xilinx的FPGA芯片上实现了帧长在64~1024之间可变的短帧长Turbo编译码模块.仿真和测试结果表明,该模块的误码率性能优良、译码延时较小、数据吞吐量大,可用于低信噪比条件下突发数据通信中的差错控制.
Turbo码、FPGA、Max-Log-Map算法、突发通信
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TN91
2006-11-13(万方平台首次上网日期,不代表论文的发表时间)
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