10.3969/j.issn.1681-1070.2016.04.007
一种无运放高电源抑制比的带隙基准设计
为满足集成电路中高电源抑制比/低温度系数的要求,设计了一款没有运放的精简的带隙电压电路.相比传统有运放结构,电路芯片面积更小且具有更低的电流损耗.并在0.5μm CMOS工艺下进行了仿真,仿真结果表明,在-40℃~+100℃温度范围内电路的温度系数为17×10-6,电源抑制此PSRR在100kHz以下达到-50 dB,在1kHz以下能达到-80 dB,而整个电路在3.3 V电压下电流损耗仅为24 μA.
电源抑制比、带隙基准、PTAT、无运放、温度系数
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TN402(微电子学、集成电路(IC))
2016-06-30(万方平台首次上网日期,不代表论文的发表时间)
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